Verilog와 SystemVerilog로 디지털 회로를 설계하고 시뮬레이션하는 방법을 실습 예제와 함께 정리합니다.
6-1. 순차 논리 회로 모델링 - 플립플롭
D 플립플롭, JK 플립플롭 등 다양한 플립플롭의 동작 원리와 Verilog 모델링 방법을 설명합니다.
6-2. 순차 논리 회로 모델링 - 래치
래치의 동작 원리와 Verilog 모델링 방법을 설명합니다. 플립플롭과의 차이점을 비교합니다.
6-3. 순차 논리 회로 모델링 - 카운터
업 카운터, 다운 카운터, 모드-n 카운터 등 다양한 카운터의 Verilog 모델링 방법을 설명합니다.
6-4. 실습: 시프트 레지스터 설계
시프트 레지스터 설계 실습을 통해 순차 논리 회로 설계를 이해하고, Verilog 코드를 작성합니다.
7-1. Verilog의 유한 상태 기계(FSM) 설계
유한 상태 기계의 개념과 Verilog를 이용한 FSM 설계 방법을 설명합니다. Moore 및 Mealy 머신을 다룹니다.
7-2. FSM 설계 예제: 시퀀스 감지기
시퀀스 감지기를 설계하는 예제를 통해 FSM 설계 과정을 실습합니다. 상태 다이어그램 및 Verilog 코드를 작성합니다.
7-3. FSM 설계 예제: 제어기 설계
간단한 제어기 설계를 통해 FSM 설계의 실용적인 측면을 다룹니다. 시스템 제어에 FSM이 어떻게 활용되는지 알아봅니다.
7-4. FSM 설계 고급: 파이프라인 기법
FSM 설계에서 성능 향상을 위한 파이프라인 기법 소개 및 예제, state encoding 기법 비교.
7-5. FSM 설계 고급: 상태 코딩 기법
FSM 상태 코딩 방식(One-hot, Gray code 등)에 대한 설명 및 장단점 비교.
3-1. Verilog의 구문 (Statement) - if-else 구문
Verilog의 제어 흐름 구문인 if-else 문을 설명하고, 조건에 따른 동작 제어 방법을 익힙니다. 예제와 함께 실습합니다.
3-2. Verilog의 구문 (Statement) - case 구문
Verilog의 case 문을 설명하고, 다양한 조건을 처리하는 방법을 배웁니다. 예제를 통해 case 문의 활용법을 익힙니다.
3-3. Verilog의 구문 (Statement) - for, while, repeat 구문
Verilog의 반복 구문인 for, while, repeat 문을 설명하고, 반복적인 작업을 효율적으로 처리하는 방법을 익힙니다.